La DRAM síncrona CMOS de alta velocidad se examina con Insignis y rsquo; flujo de prueba ampliado patentado para mitigar las fallas tempranas de la vida útil, asegurando calidad superior y confiabilidad a largo plazo para uso industrial. Tiene una interfaz síncrona (todas las señales están registradas en el borde positivo de la señal del reloj, CK). Las salidas de datos ocurren en ambos bordes ascendentes de CK y los accesos de lectura y escritura a la SDRAM están orientados a ráfagas; los accesos comienzan en una ubicación seleccionada y continúan por un número programado de ubicaciones en una secuencia programada. Los accesos comienzan con el registro de un comando de activación de banco que es seguido por un comando de lectura o escritura.
El dispositivo proporciona lecturas programables de ráfaga de lectura o escritura de 2, 4 u 8. Se puede habilitar una función de precarga automática para proporcionar una precarga de fila auto-programada que se inicia al final de la secuencia de ráfaga. Las funciones de actualización, ya sean automáticas o de actualización automática, son fáciles de usar. Además, 512 Mb DDR SDRAM cuenta con una opción de DLL programable.
Al tener un registro de modo programable y un registro de modo extendido, el sistema puede elegir los modos más adecuados para maximizar su rendimiento. Estos dispositivos son adecuados para aplicaciones que requieren un gran ancho de banda de memoria, lo que resulta en un dispositivo particularmente adecuado para aplicaciones de memoria principal y gráficos de alto rendimiento.
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